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Flash片内数据的高速回读系统设计
Design of high-speed data read back system in Flash
针对导弹飞行后数据记录装置的部分接口受损而无法顺利回读飞行数据的问题,研发了可以高速回读存储芯片片内数据的Flash读写设备,在FPGA内置的LVDS收发器基础上利用Aurora协议设计了每通道速率可达1.562 5 Gb/s的高速并行收发链路,以及在串/并转换的基础上设计了传输速度较慢的备用串行读数链路。系统实现了高速读数接口和备用读数接口皆可顺利将Flash芯片片内的数据无丢帧地回读传输至测试台进行评估、分析、利用,具有硬件设计简单、回读数据方便快捷的特点。
Aiming at the problem that part of the interface of the missile post-flight data recording device is damaged and the flight data cannot be read back smoothly.A Flash read-write device that can read back the data in the memory chip at a high speed is developed,and a high-speed parallel transceiver link with a rate of 1.562 5 Gb/s per channel is designed by using Aurora protocol on the basis of the built-in LVDS transceiver in FPGA,and an alternate serial readout link with a low transmission rate is designed on the basis of serial parallel conversion.Both the high-speed reading interface and the standby reading interface can transmit the data in the Flash chip to the test table for evaluation and utilization without losing frames.It has the features of simple hardware design,convenient and fast reading back data.
数据回读 / Aurora协议 / Flash读写 / FPGA
data read back / Aurora protocol / Flash read and write / FPGA
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为解决弹载信息处理器NAND Flash存取关键数据时,采用坏块管理和数据备份机制仍然无法避免的数据错误问题,提出一种NAND Flash全生命周期高可靠数据管理方法:以DSP软件进行坏块管理为基础,结合一种基于FPGA的改进BCH ECC校验算法,对弹载信息处理器NAND Flash全生命周期进行坏块检测评价,来提高数据管理的可靠性。提出的改进BCH ECC校验算法,采用PE单元复用方式实现读取NAND Flash数据时检9纠8实时检测。相比传统BCH ECC校验算法,该算法检测准确,占用FPGA逻辑资源少,检测速度快,非常适合高可靠性、强实时性弹载信息处理器应用场合。仿真效验结果表明,采用该方法可有效提高NAND Flash数据管理可靠性。
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