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表4 LTPF性能对比
图7
FPGA测试结果
图6
LTPF Verilog仿真波形
图5
FPGA测试电路框图
表3 MAX 10开发板主要资源数量
图4
控制模块状态图
图3
运算模块端口设计
表2 运算模块模式汇总
图2
LTPF设计框图
表1 50 Hz高通滤波器系数
图1
LTPF编码流程图
表2 现场轨道区段测试数据
图10
现场测试过程
图9
不同信噪比下相位差计算结果的均方根误差
表1 仿真测试结果
图8
DDS测试平台仿真测试
图7
DDS信号发生器硬件电路图
图6
双机同步机制流程图
图5
全相位数据处理等效框图
图4
GND2安全驱动电路图
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